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超牛 Cadence SPB 17.2-2016 新功能介绍 可极大缩短PCB的设计周期

超牛 Cadence SPB 17.2-2016 新功能介绍 可极大缩短PCB的设计周期

2016年，cadence发布了业界领先的PCB设计工具重大更新版本，Cadence SPB 17.2-2016 整合了从原理图设计、模拟/数字混合信号仿真、pcb layout、信号完整性仿真、元件库管理、设计资料文档管理等一整天的工具链。

具体的Cadence SPB 17.2-2016升级所带来的新功能介绍如下：

Cadence 17.2-2016 仅支持 64 位的操作系统，这也算是重大变更拉，用XP的同学将无法享用到 Cadence 17.2-2016。

文件版本不可以降级

即Cadence 17.2-2016 可以打开16.x版本的设计文件，但是Cadence 17.2-2016保存的文件无法再降级到16.x版本下，因此建议务必做备份。

Cadence Download Manager

使用CadenceDownload Manager可以自动获取软件更新，并可以进行自动下载、安装；用户还可以通过该工具自定义更新计划；

Installing Without AdministrativePrivileges

Cadence OrCAD、Allegro 产品的相关程序的安装目录结构变更：

  • Cadence OrCAD、Allegro 17.2-2016 的相关应用程序安装路径调整至安装路径中的/tools/bin下。因此环境变量PATH中将可不需定义 pcb/bin 及 fet/bin 的路径。而执行 Cadence OrCAD、Allegro 17.2-2016 相关应用程序亦可不需设定 17.2-2016 的相关路径于环境变量中。
  • Cadence SPB Switch Release 17.2-2016 版本切换工具已更新,其可辨别不同版本间的应用程序路径,用以自动更新应用程序与档案连结性关系。
  • 若您使用cmd控制台或批处理程序(batch file),请将您原批处理程序加入 17.2-2016 安装路径中的/tools/bin 文件夹路 径下的 allegro_cmd.bat。
  • OrCAD Products 支援 TCL 8.6 64 位版本

开始菜单

安装好软件之后,在 Windows 的开始菜单里,Cadence 产品根据不同类别进行了调整,更方便管理和查找启动。老wu试了一下，貌似在win7分组功能可以，但是win10下分组无效，反而更糟糕。

OrCAD Capture 17.2-2016 的新功能

设计差异比对

当两份电路图有所差异时,透过 Capture Compare Design 功能可以选择对电路图资料夹或是电路图图纸页面做差异比对,比对结果可查看电路图逻辑或是图形的差异。

在 Capture 命列选单中,选择 Tools >> Compare Designs 功能选单来进行电路图的差异比对。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-1 比对后将显示结果概要。透过 Show Details 功能可打开浏览器查看实际结果差异

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-2

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-3 高级零件标号编排功能（Advanced Annotation）

在Capture 中新增了高级零件标号编排的功能,在这个功能中,你可以针对不同电路图图纸页面设定不同的零件序号起始值,同时也可以针对同一页电路图图纸不同零件设定不同的起始序号。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-4 另可对层级式电路中,不同层级设定不同序号起始设定。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-5 亦可针对不同属性区块进行群组零件标号编排

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-6 新增个人工作环境设定

OrCAD Capture 现在对使用者环境设定,有更加高级的设定界面,使用功能选单中的 Option >> Preference >> More Preference 进入设定界面。在新的 Extended Preferences Setup 中,可以针对以下环境做高级设定:

  • 命令窗口（Command Shell）
  • 设计及零件库(Design and Libraries)
  • 设计缓存(Design Cache)
  • 设计规则检查(DRC)
  • OrCAD Capture CIS (CIS)
  • 网络群组(NetGroup)
  • 网表(NetList)
  • 电路图(Schematic)

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-7 范例设计浏览

在 Cadence 17.2-2016 软件安装目录中,整合并提供了 150 个以上的范例档案让使用者可以快速了解及学习 OrCAD Capture、OrCAD Capture CIS 以及 OrCAD Capture–OrCAD PSpice 设计流程的设计。在 OrCAD Capture 17.2-2016 中,可以简单地透过 File – Open – Demo Design 的功能选单开启内建范例档案。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-8 XML 档案格式的输出与输入

OrCAD Capture 使用File –> Export –> Design XML 或 Library XML 指令以及File –> Import –> Design XML 或Library XML 指令,可以透过<程式安装目录中>\tools\capture\tclscripts\capdb\dsn.xd、olb.xd 程式将电路图、零件库输出为XML 格式,以及将XML 格式重新载入成为标准电路图、零件库。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-9

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-10 Intel Schematic Export Format (ISCF)格式输出

OrCAD Capture 可以使用 File –> Export –> ISCF 介面针对电路图零件、管脚属性与接地信号输出 Intel Schematic Export Format (ISCF) 格式。此格式可以通过用户界面设定零件或零件管脚属性的输出,输出后这些设定将被存档于 Caputre.ini 档案中以便下次使用不需重新设定。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-11 PDF输出

从OrCAD Capture 17.2-2016 版本后,若你的电脑有安装ghostscript 32 bit、ghostscript 64 bit、 Adobe Acrobat Distiller…等程序,可以使用File –> Export –> PDF 的功能命令将电路图直接导出为PDF文档。导出内容包含:

OrCAD Capture 设计

  • 显示设计层级架构
  • 显示零件序号列表
  • 显示网络及与其连接的零件脚位
  • 可跳转至层级式方块内的设计
  • 点选元件可显示元件属性
  • 导览显示 off-page connector 的连结

OrCAD Capture 设计元件

此元件属性 PDF 文档支持与 OrCAD Capture PDF 文档的 cross-probing 功能。

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cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-13 新增 OrCAD PSpice 仿真模型于 Capture –> PSpice 设计流程

OrCAD Capture 对于 Capture -> PSpice 设计流程,新增 OrCAD PSpice 仿真模型,如下表。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-14 其他项目的新增功能

针对电路图 Intersheet Reference 功能,增加对 X 轴向可偏移的设定,可设定负数值做偏移位置设定。

OrCAD Capture CIS 17.2-2016 新功能

水晶报表 (Crystal Report)

OrCAD Capture CIS 17.2-2016 版本预设针对 ODBC 连接数据库与水晶报表(Crystal Report)的连接方式改为使用 SQLite 连接到数据库中。

连接信息如下:

DRIVER=SQLite3 ODBC Driver;Database=”SQLite DB file Name”;LongNames = 0;Timeout = 1000; NoTXN = 0;SyncPragma=NORMAL;StepAPI=0;NoWCHAR=1;

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-15 OrCad PSpice 17.2-2016 新功能

PSpice DMI (Device Modeling Interface)Template Code 产生器

于 PSpice 17.2-2016 可使用 PSpice 模型编辑器(Model Editor)的 DMI (Device Modeling Interface)Template Code 产生器产出 PSpice 连接码(Adaptor code)。 PSpice 连接码启动 PSpice 仿真时使用 PSpice DMI DLL 文档。将模拟/数字的 C/C++及 SystemC 模型(Model)的模型码(Model Code)加入 PSpice 连接码中并使用 Microsoft Visual Studio Express 2013 建立 PSpice DMI DLL 库。当 Spice DMI DLL 库产生后,将其对应的 PSpice 模型(.lib)使用 PSpice 模型编辑器快速建立 OrCAD Capture 元件,便可运用此 PSpice 模型于 PSpice 设计仿真流程中。

PSpice DMI Template Code 产生器提供以下元件类型:

模拟基础元件：

  • 通用零件(Generic device)
  • 电压控制电压源(Voltage-Controlled Voltage Source)
  • 相依电压源(Function-Dependent Voltage Source)
  • 电压控制电流源(Voltage-Controlled Current Source)
  • 相依电流源(Function-Dependent Current Source)
  • 两端点零件(Generic Two-Node Device)
  • 三端点零件(Generic Three-Node Device)

数字 C/C++基础零件

SystemC 基础零件

Verilog-A 基础零件

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-16 新增行为仿真模型的延迟(Delay)功能

DelayT()及 DelayT1()功能简化传统上使用的延迟功能,例如,TLINE 及 Laplace 函数,其减少在收敛上的问题,并比传统功能信号(电压或电流)有更快的计算。

–DelayT() 功能的语法为 delayt(v(x),, ) 例:E2 out 0 value {delayt(V(x),5m, 10m)}
–DelayT1()功能的语法为 delayt1(v(x),) 例:E2 out 0 value {delayt1(V(x),5m)}

OPTIONS 指令的 Flag 选项新增 SKIPTOPO

当 Flag 选项设定 SKIP TOPO = 1 时,则 OrCAD Capture 将跳过拓扑检查(topology checks)。

例:.options SKIPTOPO = 1

支持使用负值于迟滞电压(Hysteresis voltage)及临界电压(threshold voltage)中

OrCAD PCB Designer 17.2-2016 新功能

全新 Padstack 编辑器界面

新的 Padstack Editor 界面,简化了设定各种不同 Padstack 的不必要的步骤,使用者只需要在 Start 页面选择要建立的种类与几何形状之后,就能在其他页面进行相关细节的设定。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-17 动态铜支持分层定义

对于动态铜的 Pin/Via 连接及隔离设定,在新的版本中能够分层来做特别的定义。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-18 以下的设置也支持分层设定：

  • Dyn_clearance_oversize_array 
  • Dyn_clearance_type
  • Dyn_fixed_therm_width_array 
  • Dyn_max_thermal_conns
  • Dyn_min_thermal_conns
  • Dyn_oversize_therm_width_array 
  • Dyn_thermal_best_fit
  • Dyn_thermal_con_type

全新的层叠结构界面

重新设计的叠构编辑设定,充分运用表格式的方法来进行相关设定,其创意来自于 Constraint Manager 的格式,藉由一致性的表格来让使用者操作上更为易用。

新的界面整合了 Unused Pad Suppression 与 Embedded Component 设定还有支持了非电气层的部 ,如:Solder mask, Paste, Coverlay…等;另外对于 Material 的字符长度也扩展到 250 个字符。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-19 支持软硬结合板的多重叠构设计

对应多重叠构的软硬结合板设计,可透过 Cross Section Editor 设定。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-20 软硬板的区域范围管理

新增实体区域来分别定义软板或硬板的区域范围。

新增 Classes 及 Subclass 类型

加入软硬结合板及表面处理的 Class。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-21 新增 Design Outline 及 CUTOUTS subclasses

对于 Board Geometry 新加入了 Design Outline 及 CUTOUTS 的 subclass 供日后更宽广的应用。

动态区域摆放

对于不同叠构层面的软硬结合板,在摆放零件时能够依照所属的区域将零件摆放到正确的层面上

新增动态网状铜

动态铜现在能直接铺设网状铜。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-22 软件结合板的Inter Layer Checks

软硬结合板设计因分别拥有不同的mask 及表面涂层,并且对于软板部分还会有弯折的区域,所以要能够确实做到相对的检查以避免设计因生产组装时发生错误,就能透过Inter Layer Checks 设定相关检查条件。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-23 弯折区域对于 Pin, Via 的检查

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-24 覆盖范围检查

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-25

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-26

软硬结合板的生产资料

Cross section chart支持多重叠构的表格

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-27 动态泪滴铺铜设置

动态补泪滴补铜现在可对各层面进行设定。

新增缺少的 Tapered trace 执行输出报告

新增的报表,可将缺少的渐变 Tapered trace 输出报表

多元的编辑指令模式

v16.6-2015 时新增可快速对 Shape 编辑的操作模式,在 v17.2 延续良好的操作编辑特性,再加入了更 多元的编辑指令。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-28 全新的 Color Dialog

资料的呈现是很重要的一环,因此新的 Color dialog 将会让您以更快速更有效率的方式来操作使用。

新的视觉呈现

新的界面以标签页方式来呈现 Layers / Nets / Display / Favorites / Visibility Pane。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-29 并且能透过 Filter 快速筛选出想设定的元件出来。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-30 Visbility pane 可以控制显示物件种类,以及在多重叠构下各叠构显示的层面设定

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-31 用户界面的更新

可自定义的工具栏

提供更能够个人化的自定义工具栏属性,现在能让更多指令变成一个图标。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-32 状态栏的显示与隐藏设定

现在您可以设定 Status bar 上需要显示或隐藏的信息。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-33 锐角检测

对于锐角的检查,使用者可以通过定义锐角角度来将以下四种情况进行确认。

  • Line to Pad
  • Line to Shape
  • Shape Edge to Edge
  • Line to Line

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-34

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-35 孔的间距检查

通过 Check holes within pads 的设定,无论 Hole 有无 Pad 皆会依 CM Spacing 内 Hole 的间距设定执行检查。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-36 Refresh Symbol – 维持 Padstacks 定义

如果设计当中有对零件包装进行 Replace Padstack,那么在 Refresh Symbol 时能够选择是否要保留 现在设计中的 Padstack 名称而不被刷新。

cadence-spb-17-2-2016-%e6%96%b0%e5%8a%9f%e8%83%bd%e4%bb%8b%e7%bb%8d-37 效能提升

CPU 效能提升 10-20%。

Import logic 对于有很多 Pin 数的 Device(>2k pins)条件时,处理速度比以往都要快。

字符长度增加

Default internal 的名称长度由原本的 32 个字符现可增加到 255 个字符。

 

Cadence SPB 17.2-2016 新功能介绍视频

阅读: 329,802
吴川斌

吴川斌

33 Comments

    啊贵
  • 啊贵 says:
    2021年6月15日 at 下午3:29

    不清楚，谢谢！目前暂时用16.6绘制焊盘

    • 啊贵
  • 啊贵 says:
    2021年6月15日 at 下午1:29

    吴大师你好！最近有个问题一直受困，allegro17.2 Padstack Editor 用了一段时间 打不开了，双击圈圈没反应 重新破解也没用，卸载重新安装也不行，不知道哪里出问题 16.6焊盘编辑器没遇到过这种问题。 是不是丢失了什么关键文件导致17.2 Padstack Editor 打不开了？

      吴川斌
    • 吴川斌 says:
      2021年6月15日 at 下午2:18

      不知道是不是微软输入法的更新造成的问题

        Johnson
      • Johnson says:
        2022年1月14日 at 上午9:04

        我也是同样的问题，困扰我几天了。

    • 大玺子
  • 大玺子 says:
    2021年4月19日 at 下午8:59

    老师您好，最近用pspice仿真出现了一个问题，当两个独立的电路放在一张原理图中，无任何连接线，仿真时会导致仿真结果错误；但是分开放在各自的图纸中仿真又是正确的，这是为什么呢？

  • L says:
    2020年8月14日 at 上午12:25

    吴老师您好，请问下为什么装了cadence 17.2和sigrity2017，还是没有Allegro PCB PI option XL呢？我看不少讲PI的资料都是用这个。

  • 灰烬 says:
    2020年8月6日 at 上午10:37

    吴老师您好，请问您的ORCAD 16.6版本是不能生成系统自带的电路示例吗？

  • 姚远 says:
    2020年7月7日 at 下午2:47

    老吴，又来请教你问题了。我这两天安装了Cadence 17.2和补丁，在原理图添加文本的时候想输入汉字，但是在文本框里面显示的就是“？”。但是从Word文档里面拷贝中文到Cadence里面的文本框就可以显示中文。请问这是什么原因造成的啊？怎么操作可以修正呢？
    谢谢！

      萤火虫
    • 萤火虫 says:
      2021年7月7日 at 下午12:38

      我在16.6的版本中汉字可以在文本复制后贴过来。17.2还没试过。您可以试试哦。

  • LY says:
    2020年5月24日 at 下午4:02

    17.2版本安装了补丁程序后，信息窗口显示都没有内容了，这是啥原因啊

    • says:
      2020年5月25日 at 上午9:05

      初始版本没问题，打了补丁之后才无法显示吗？

      • ly says:
        2020年5月25日 at 上午9:15

        是的，17.2初始版本没问题。但会经常闪退。打补丁后，信息显示窗就不正常了。重新装了几次也是这样的。软件安装在虚拟机环境中的。

        • says:
          2020年5月25日 at 下午3:13

          显示信息这款它是调用了IE的功能，看看浏览器核心组件这块是不是被第三方软件给修改过了

  • 彭战军 says:
    2020年4月8日 at 下午1:00

    为什么下载的Cadence 17.2要解压密码呢？

  • 晴空 says:
    2020年4月6日 at 下午11:14

    吴老师您好，

    我使用AleegoCrackMasterV3.0.2安装的Cadence SPB 17.2-2016 http://www.mr-wu.cn.7z，阿狸狗也显示破解成功了。Capture CIS是可以打开使用的，就是打开使用一会后，有闪退现象。我的系统是windows 7 专业版 64位，Service Pack1 。

    请问老师您遇到过吗？

  • smychier says:
    2020年3月13日 at 下午3:06

    有一个问题不知道您能不能看到，用阿狸狗装了cadence16.5但是pspice-new simulation profile 的时候总是cannot initialize profile，路径全英文，并且orsimsetup文件也在

  • 丁方超 says:
    2017年9月21日 at 下午4:48

    请问吴老师一下为什么安装完以后，capture 显示是LITE版本啊，会有Pin net component的数量限制，这个怎么处理一下？

    • says:
      2017年9月22日 at 下午2:26

      你打开的方式不正确 不要打开lite版本 运行那个标准的版本

  • 杨志 says:
    2017年3月30日 at 上午9:22

    吴老师，您好！
    请问安装spb 17.2以后，UltraLibrarian和LP_wizard10_5都不能用了，有解决办法吗？谢谢！

  • 余云森 says:
    2017年3月23日 at 下午6:46

    老吴 你好 ： 我这边使用的是阿狸狗安装的cadence软件 17.2spb版本，安装完成后，然后这边一直不能正常使用老是提示license was not found ？ 我这边自己已经尝试重新安装卸载多次了，一直没有解决这个问题。
    备注下：我前有安装过17.2 然后卸载了，然后安装了16.6版本的，最近把16.6卸载了，重新安装17.2版本的；但是现在一直安装不成功。我百度过你的博客，安装前我确定是已经将16.6版本的liscence manager 卸载了的；期间我也用过阿狸狗的 强烈清除注册列表残留功能，但还是行不通 。我希望您这边能帮我找下原因谢谢了

      萤火虫
    • 萤火虫 says:
      2021年7月7日 at 下午12:40

      应该 在LMTOOL中把服务stop下，再重新启动，说不定就可以了。当然license要对。

  • fox says:
    2017年3月17日 at 上午9:24

    吴老师请问allegro转pads可不可以出相关视频啊跪求啊谢谢

      萤火虫
    • 萤火虫 says:
      2021年7月7日 at 下午12:43

      同求吴老师发下allegro 转 pads的视频。转换过程在网上查过 设置 环境变量，以及那个啥设置成1，还把script拷到指定位置后，在运行dfl_main.il后，输入main out后跑一跑就有报错。有些报错改了，有些报错都不知道在哪里，看着都没啥问题呀。什么device有问题，什么叠层看不到，但明明都有的不知道哪里出毛病了各种问题，求吴老师给指条明路呀。谢谢。

  • 老虎 says:
    2016年11月7日 at 下午3:10

    吴老师，又来麻烦你了，为什么这里只有TRUE啊，那我怎么解锁啊？

  • Deck says:
    2016年11月3日 at 下午6:41

    请问一下，用orcad17.2的capture导出PDF时，提示找不到postscript driver怎么办？

  • 老虎 says:
    2016年10月18日 at 下午6:03

    快捷键无效也是吗？

    • 桐朴 says:
      2016年10月23日 at 下午5:07

      Cadence SPB 17.2-2016 http://www.mr-wu.cn 。7z的解压密码是多少？Orz

      • 老虎 says:
        2016年10月23日 at 下午5:13

        吴大神的网址

      • 吴川斌 says:
        2016年10月23日 at 下午11:49

        不需要解压 直接用阿狸狗破戒大师安装 下载地址：http://aligou.mr-wu.cn

  • 吴川斌 says:
    2016年10月18日 at 下午5:50

    格点设置的问题

  • 老虎 says:
    2016年10月18日 at 下午5:31

    吴大师，我破解的cadence 16.6， 在ORCAD 里面复制器件拖动的时候，光标和器件都不在一个点上，这个是bug吗？然后好多快捷建，比如R，翻转器件，似乎不能用了呢！ PS：真心感觉你牛x，以一个人的力量推动一件很牛逼的事情。

      萤火虫
    • 萤火虫 says:
      2021年7月7日 at 下午12:46

      快捷键要自己重新设置一下吧。查看下您的env里 funckey R 是不是 rotate？可能已经变了。还要查下是不是有重复的funckey指令，只有最下面的funckey才有效。因为被复盖了。

  • 徐旭 says:
    2016年10月14日 at 上午10:58

    厉害

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